Thiết kế và tối ưu bộ giải mã TPC trên FPGA

Tóm tắt

Trong bài báo này, chúng tôi đề xuất giải pháp thực thi giải mã hóa mã TPC – Turbo Product Code – trên FPGA (Field Programmable Gate Array) cho các hệ thống thông tin liên lạc. Thiết kế dựa trên phương pháp giải mã lặp sử dụng thuật toán Chase-Pydiah nhằm nâng cao hiệu năng giải mã. Nhóm tác giả đơn giản hóa thuật toán giải mã, không sử dụng bộ nhân khi tính toán thông tin ngoại lai tại mỗi vòng lặp nhưng không làm giảm hiệu năng giải mã. Thực thi trên Xilinx Artix7 xc7a200tfbg484-1 tại clock 200MHz, tốc độ giải mã đạt tới 800Mbps.